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的TMS320C64x的DSP（包括TMS320C6414T，TMS320C6415T，TMS320C6416T设备†）
是在TMS320C6000DSP平台的最高性能的定点DSP生成。 “
（的TMS320C64x的C64x）设备是基于第二代高性能，先进VelociTI
超长指令字（VLIW）架构（VelociTI.2）德州仪器（TI），
这些DSP无线基础设施应用的一个很好的选择。是一个代码兼容的C64x
C6000DSP平台的成员。
由于其性能高达8000百万条指令每秒（MIPS）的时钟频率为1 GHz的C64x器件
提供符合成本效益的解决方案，以高性能DSP编程挑战。该C64x的DSP具备
高速控制器和数值阵列处理器的能力的操作灵活性。该C64x
DSP核心处理器有64个32位字长的通用寄存器和8个独立
功能单元，两个乘法器，一个32位的结果和6个算术逻辑单元（ALU的） - 与VelociTI.2中
扩展。的VelociTI.2扩展8个功能单元，包括新的指令，以加速
关键应用的性能和延长的VelociTI架构的并行性。该C64x可以产生
4个16位乘法累加（MAC）的每个周期每秒（MMACS）共4000万台Mac电脑，或
8个8位的MAC每个周期为总共8000 MMACS。 C64x DSP的也有特殊应用的硬件
逻辑，片上存储器，以及类似的其他C6000DSP平台器件额外的片上外设。
该的C6416T设备有两个高性能嵌入式协处理器的维特比解码器协处理器（VCP）
和Turbo解码器协处理器（TCP）]显着加快通道解码操作片上。 “
VCP操作在CPU时钟划分-4可以解码超过833 7.95-Kbps的自适应多速率（AMR）的[K = 9，
R = 1/3]语音信道。 VCP支持约束长度ķ= 5，6，7，8和9，速率R = 1/2，1/3，和1/4，
灵活的多项式，而产生艰难的决定或软判决。 TCP运行在CPU时钟
分-2解码高达60 384 Kbps或10 Mbps的涡轮编码通道（假设6次迭代）。
TCP实现最大* LOG-MAP算法，并支持所有多项式和价格
由第三代合作伙伴项目（3GPP和3GPP2），具有完全可编程的帧的长度和涡轮增压
交织。如解码参数的数目的迭代次数和停止准则也可编程。
VCP / TCP和CPU之间的通信是通过EDMA控制器。