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产品详情

CY2305SC-1HT

特征

■不推荐用于新设计。该cy2305c和

cy2309c形式，配合，功能兼容设备

改进的规格。

■10兆赫至100 / 133 MHz的工作范围，兼容的CPU

和PCI总线频率

■零输入输出延迟

■60 ps的典型循环周期抖动（高驱动）

■多个低偏移输出

❐85 ps的典型的输出至输出歪曲

❐一输入驱动器五输出（cy2305）

❐一输入驱动器九输出，分为4 + 4 + 1（cy2309）

■兼容奔腾系统

■测试方式绕过锁相环（PLL）（cy2309）

■包：

❐引脚，150 mil SOIC封装（cy2305）

❐16针150 mil SOIC或4.4-mm TSSOP（cy2309）

■3.3V的操作

■商业和工业温度范围

功能描述

是一种低成本的cy2309 3.3V的零延迟缓冲器设计

分配高速时钟和可在一个16引脚SOIC或

采用TSSOP封装。是的cy2305的8引脚版本

cy2309。它接受一个参考输入，并带动了五低

歪斜的时钟。的1H版本的每个设备工作在高达

100 / 133兆赫的频率，并具有比1更高的驱动

设备。所有部件都在芯片锁相环锁定到输入时钟

在REF引脚。PLL的反馈是片上，得到

从CLKOUT垫。

该cy2309有两排各四输出，可

通过选择输入在“选择输入控制

解码cy2309”在4页。如果所有的输出时钟不

要求，bankb可以说明三。选择输入

允许输入时钟，可以直接用于输出芯片

系统测试的目的。

该cy2305和cy2309锁相环进入省电模式时

有没有在REF输入的上升沿。在这种状态下，该

输出有三说，PLL的关闭，导致

小于25μ这些部件的电流。该cy2309锁相

关闭在一个额外的情况下，在“选择输入

解码cy2309”在4页。

多cy2305和cy2309设备可以接受相同的输入

时钟和分发。在这种情况下，输出之间的偏差

两个装置是保证是小于700 ps。

此外，无论数量或金额大小，我们对所有询价、订单一视同仁!