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74HC4052PW

基本概述：

74年的hc4052;74HC4052PW是一个高速si门CMOS器件与HEF4052B兼容。该设备是指定符合JEDEC标准没有7 a。74年的hc4052;74HC4052PW是一个双重4通道模拟多路复用器/解复用器与常见的选择逻辑。每个多路复用器有四个独立的输入/输出(nY0别针,nY3)和一个常见的输入/输出(销新西兰)。通用通道选择逻辑包括两个数字选择输入(销S0,S1)和一个活跃的低允许输入(销E)。当销E =低,其中的四开关被选中(低阻抗的使用状态)用图钉S0,S1。当销E =高,所有的开关在高阻抗断开的、独立的别针S0,S1。VCC和接地的电源电压大头针的数字控制输入(销S0,S1和E),VCC接地范围是2.0 V 10.0 V为74年hc4052和4.5 V 5.5 V为74年hct4052。

                模拟输入/输出nY0别针,nY3和新西兰)可以作为一个积极之间摆动VCC限制和v字形作为一个消极的限制。74HC4052PW的VCC - V字形不得超过10.0 V。对于操作作为一个数字多路复用器/解复用器、三角连接到接地(通常是地面)。

功能特性：

宽模拟输入电压范围从5 V + 5 V

低电阻:

80Ω(典型的)在VCC - V字形= 4.5 V

70Ω(典型的)在VCC - V字形= 6.0 V

60Ω(典型的)在VCC - V字形= 9.0 V

逻辑电平:使5 V逻辑与±5 V模拟信号典型的“先断后的内置

符合JEDEC标准

ESD保护:

JESD22-A114F HBM超过2000 V

MM JESD22-A115-A超过200 V

CDM JESD22-C101E超过1000 V

从-40℃指定到+ 85℃和-40℃到+ 125℃

应用程序:

模拟多路复用和多路分解

数字多路复用和多路分解

信号控制

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